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[填空题]通常模值相同的同步计数器比异步计数器的结构（），工作速度（）。
[单项选择]利用M进制计数器构成N（N＜M）进制计数器，异步清0法或异步置0法用于产生清0或置0信号的状态是SN，同步清0法或同步置0法用于产生清0或置0信号的状态是（）
A. SN-1
B. SN-2
C. SN
D. SN+1
[简答题]用VHDL设计一个功能类似74LS160（异步复位和同步使能加载的十进制加法计数器）的计数器。
[单项选择]一异步三位二进制加法计数器，当第8个CP脉冲过后，计数器状态变为（）。
A. 000
B. 010
C. 110
D. 101
[判断题]同步计数器是将计数脉冲同时输入到各级触发器，当输入计数时钟脉冲触发时，各级触发器的状态同时发生转移。
[简答题]给出含有异步清0和计数使能的16位二进制加减可控计数器的VHDL描述。
[单项选择]按计数器状态变化的规律分类，计数器可分为（）计数器。
A. 加法、减法和可逆
B. 同步和异步
C. 二、十和N进制
D. 一位和N位
[单项选择]用触发器设计一个同步十七进制计数器所需要的触发器数目是（）。
A. 2
B. 3
C. 4
D. 5
[单项选择]四位异步二进制减法计数器，先清零，2个脉冲后输出状态为（）
A. 1110
B. 0010
C. 1011
D. 0001
[简答题]试描述一个异步复位、二十进制的减法计数器，写出FPGA程序。
[单项选择]某计数器在计数过程中，当计数器从111状态变为000状态时，产生进位信号，此计数器的计数长度是（）
A. 8
B. 7
C. 6
D. 3
[单项选择]三位异步二进制加法计数器的输出状态为110，2个脉冲后输出为（）
A. 000
B. 001
C. 101
D. 111
[简答题]定时器/计数器用作计数器模式时，对外界计数频率有何限制？
[简答题]试描述一个同步置数、同步清零的8位加法计数器，写出FPGA程序。
[简答题]可编程计数器/定时器8253选用二进制与十进制计数器的区别是什么？每种计数器的最大计数值分别为多少？
[单项选择]如果减计数器的计数初值为10H，则减计数可作为（）分频计数器用。
A. 十
B. 二
C. 十六
D. 与计数初值无关
[单项选择]8253计数／定时器内部有三个独立的计数器，这些计数器实际上是+（）
A. 16位的减法计数器
B. 8位的加法计数器
C. 16位的加法计数器
D. 8位的减法计数器
[判断题]可逆计数器既能作加法计算器，有能做减法计数器。
